Files
SlugCross_MiSTer/rtl/FlashModule.v
2022-03-13 16:28:43 -06:00

32 lines
611 B
Verilog

`timescale 1ns / 1ps
//////////////////////////////////////////////////////////////////////////////////
// Company:
// Engineer:
//
// Create Date: 11/29/2018 06:53:02 PM
// Design Name:
// Module Name: FlashModule
// Project Name:
// Target Devices:
// Tool Versions:
// Description:
//
// Dependencies:
//
// Revision:
// Revision 0.01 - File Created
// Additional Comments:
//
//////////////////////////////////////////////////////////////////////////////////
module FlashModule(
input flash,
input sec,
output flashOut
);
assign flashOut = sec & flash;
endmodule