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VIDEO: added gbc palettes registers to read/write block
This commit is contained in:
Bruno Duarte Gouveia
109
video.v
109
video.v
@@ -23,6 +23,7 @@ module video (
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input reset,
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input clk, // 4 Mhz cpu clock
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input clk_dma,
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input isGBC,
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// cpu register adn oam interface
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input cpu_sel_oam,
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@@ -136,6 +137,22 @@ reg [7:0] wy_r; // stable over entire image
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reg [7:0] wx;
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reg [7:0] wx_r; // stable over line
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//ff68-ff6A GBC
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//FF68 - BCPS/BGPI - Background Palette Index
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reg [5:0] bgpi; //Bit 0-5 Index (00-3F)
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reg bgpi_ai; //Bit 7 Auto Increment (0=Disabled, 1=Increment after Writing)
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//FF69 - BCPD/BGPD - Background Palette Data
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reg[7:0] bgpd [63:0]; //64 bytes
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//FF6A - OCPS/OBPI - Sprite Palette Index
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reg [5:0] obpi; //Bit 0-5 Index (00-3F)
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reg obpi_ai; //Bit 7 Auto Increment (0=Disabled, 1=Increment after Writing)
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//FF6B - OCPD/OBPD - Sprite Palette Data
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||||
reg[7:0] obpd [63:0]; //64 bytes
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// --------------------------------------------------------------------
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// ----------------------------- DMA engine ---------------------------
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// --------------------------------------------------------------------
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@@ -151,7 +168,7 @@ always @(posedge clk_dma) begin
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dma_active <= 1'b0;
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else begin
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// writing the dma register engages the dma engine
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if(cpu_sel_reg && cpu_wr && (cpu_addr[3:0] == 4'h6)) begin
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if(cpu_sel_reg && cpu_wr && (cpu_addr == 8'h46)) begin
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dma_active <= 1'b1;
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dma_cnt <= 10'd0;
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end else if(dma_cnt != 160*4-1)
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@@ -170,7 +187,7 @@ always @(posedge clk) begin
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//TODO: investigate and fix timing of lyc=ly
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// lyc=ly coincidence
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if(stat[6] && (h_cnt == 1) && lyc_match) //h_cnt==0 too late, when early(say h_count=1 messes up radarmission)
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if(stat[6] && (h_cnt == 1) && lyc_match)
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irq <= 1'b1;
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// begin of oam phase
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@@ -189,7 +206,7 @@ end
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// --------------------------------------------------------------------
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// --------------------- CPU register interface -----------------------
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// --------------------------------------------------------------------
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integer ii=0;
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always @(posedge clk) begin
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if(reset) begin
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lcdc <= 8'h00; // screen must be off since dmg rom writes to vram
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@@ -201,21 +218,53 @@ always @(posedge clk) begin
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bgp <= 8'hfc;
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obp0 <= 8'hff;
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obp1 <= 8'hff;
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bgpi <= 6'h0;
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obpi <= 6'h0;
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bgpi_ai <= 1'b0;
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obpi_ai <= 1'b0;
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for (ii=0;ii<64;ii=ii+1)begin
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bgpd[ii] <= 8'h00;
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obpd[ii] <= 8'h00;
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end
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end else begin
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if(cpu_sel_reg && cpu_wr) begin
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case(cpu_addr[3:0])
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4'h0: lcdc <= cpu_di;
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||||
4'h1: stat <= cpu_di;
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||||
4'h2: scy <= cpu_di;
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||||
4'h3: scx <= cpu_di;
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||||
case(cpu_addr)
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||||
8'h40: lcdc <= cpu_di;
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||||
8'h41: stat <= cpu_di;
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||||
8'h42: scy <= cpu_di;
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||||
8'h43: scx <= cpu_di;
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||||
// a write to 4 is supposed to reset the v_cnt
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||||
4'h5: lyc <= cpu_di;
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||||
4'h6: dma <= cpu_di;
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||||
4'h7: bgp <= cpu_di;
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||||
4'h8: obp0 <= cpu_di;
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||||
4'h9: obp1 <= cpu_di;
|
||||
4'ha: wy <= cpu_di;
|
||||
4'hb: wx <= cpu_di;
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||||
8'h45: lyc <= cpu_di;
|
||||
8'h46: dma <= cpu_di;
|
||||
8'h47: bgp <= cpu_di;
|
||||
8'h48: obp0 <= cpu_di;
|
||||
8'h49: obp1 <= cpu_di;
|
||||
8'h4a: wy <= cpu_di;
|
||||
8'h4b: wx <= cpu_di;
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||||
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||||
//gbc
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||||
8'h68: begin
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||||
bgpi <= cpu_di[5:0];
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||||
bgpi_ai <= cpu_di[7];
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||||
end
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||||
8'h69: begin
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||||
bgpd[bgpi] <= cpu_di;
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||||
if (bgpi_ai)
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||||
bgpi <= bgpi + 6'h1;
|
||||
end
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||||
8'h6A: begin
|
||||
obpi <= cpu_di[5:0];
|
||||
obpi_ai <= cpu_di[7];
|
||||
end
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||||
8'h6B: begin
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||||
obpd[obpi] <= cpu_di;
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||||
if (obpi_ai)
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||||
obpi <= obpi + 6'h1;
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||||
end
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||||
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||||
endcase
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||||
end
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||||
end
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@@ -223,18 +272,24 @@ end
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assign cpu_do =
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cpu_sel_oam?oam_do:
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||||
(cpu_addr[3:0] == 4'h0)?lcdc:
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||||
(cpu_addr[3:0] == 4'h1)?{1'b1,stat[6:3], lyc_match, mode}:
|
||||
(cpu_addr[3:0] == 4'h2)?scy:
|
||||
(cpu_addr[3:0] == 4'h3)?scx:
|
||||
(cpu_addr[3:0] == 4'h4)?ly:
|
||||
(cpu_addr[3:0] == 4'h5)?lyc:
|
||||
(cpu_addr[3:0] == 4'h6)?dma:
|
||||
(cpu_addr[3:0] == 4'h7)?bgp:
|
||||
(cpu_addr[3:0] == 4'h8)?obp0:
|
||||
(cpu_addr[3:0] == 4'h9)?obp1:
|
||||
(cpu_addr[3:0] == 4'ha)?wy:
|
||||
(cpu_addr[3:0] == 4'hb)?wx:
|
||||
(cpu_addr == 8'h40)?lcdc:
|
||||
(cpu_addr == 8'h41)?{1'b1,stat[6:3], lyc_match, mode}:
|
||||
(cpu_addr == 8'h42)?scy:
|
||||
(cpu_addr == 8'h43)?scx:
|
||||
(cpu_addr == 8'h44)?ly:
|
||||
(cpu_addr == 8'h45)?lyc:
|
||||
(cpu_addr == 8'h46)?dma:
|
||||
(cpu_addr == 8'h47)?bgp:
|
||||
(cpu_addr == 8'h48)?obp0:
|
||||
(cpu_addr == 8'h49)?obp1:
|
||||
(cpu_addr == 8'h4a)?wy:
|
||||
(cpu_addr == 8'h4b)?wx:
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||||
isGBC?
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||||
(cpu_addr == 8'h68)?{bgpi_ai,1'd0,bgpi}:
|
||||
(cpu_addr == 8'h69)?bgpd[bgpi]:
|
||||
(cpu_addr == 8'h6a)?{obpi_ai,1'd0,obpi}:
|
||||
(cpu_addr == 8'h6b)?obpd[obpi]:
|
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8'hff:
|
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8'hff;
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// --------------------------------------------------------------------
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