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SharpMZ/common/pll/pll_inst.v
Philip Smart 4a64af4a00 Initial commit
2019-10-25 17:16:34 +01:00

25 lines
1.6 KiB
Verilog

pll u0 (
.clk_clk (<connected-to-clk_clk>), // clk.clk
.pll_0_outclk1_clk (<connected-to-pll_0_outclk1_clk>), // pll_0_outclk1.clk
.pll_0_outclk2_clk (<connected-to-pll_0_outclk2_clk>), // pll_0_outclk2.clk
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.pll_2_outclk3_clk (<connected-to-pll_2_outclk3_clk>), // pll_2_outclk3.clk
.pll_2_reset_reset (<connected-to-pll_2_reset_reset>), // pll_2_reset.reset
.reset_reset_n (<connected-to-reset_reset_n>) // reset.reset_n
);